相鎖迴路(PLL)之拉氏分析及於接收機應用之研究

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題名:	相鎖迴路(PLL)之拉氏分析及於接收機應用之研究
作者:	林坤池
貢獻者:	電機工程系 Department of Electrical Engineering
關鍵詞:	相鎖迴路(PLL);拉氏分析
日期:	1983-06
上傳時間:	2008-12-09 10:54:01 (UTC+8)
出版者:	勤益科技大學
摘要:	本文就相鎖迴路(PHASE LOCKED LOOP)簡稱PLL在接收機方面作一實際的探討。其基本原理是用數字選台，閉迴路鎖住本地振盪的頻率，所以選台非常快捷，準確性高且不會因溫度的變化而引起頻率的偏移。第一章PLL的理論分析，以拉氏分析作一簡單的介紹。第二章PLL的重要電路結構作概要說明。第三章詳細的說明相鎖回路在接收機方面設計要點，至於其它接收電路不是本論文重點，則以簡單圖文介紹，第四章結論，介紹PLL在其它方面的應用。隨著積體電路技術發展，以及電子產品的高級化，相鎖迴路配合時代潮流，恰好合乎此要求，而其應用除接收機、馬達的速度控制等外，其應用範圍正在擴大中。
關聯:	勤益學報 No.1 p.98-120
顯示於類別:	[勤益科技大學] 勤益學報

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